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FPGA常用算法列举004——4

时间:2014-5-16 20:36:42 点击:

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基于FPGASDRAM控制器设计方案

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针对高速实时图像采集系统中数据量大需要缓存的问题,提出一种基于FPGASDRAM控制器设计方案。在分析SDRAM基本操作原理的基础上,通过引入状态机和仲裁机制,利用Verilog语言在QuartusII的开发环境中进行设计输入与仿真验证,实现了高速数据的缓存和传输。详细介绍各模块的具体设计方法以及整体设计的实现过程。实验测试结果表明:该控制器设计灵活、工作稳定可靠,成本低廉,可作为IP核应用于不同SOC的高速缓存系统中。

 

 

自适应滤波器的FPGA实现及应用

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论文通过这三个模块的实现方法不同,用三种方法在FPGA中实现了LMS算法的自适应滤波器,分别是NiosⅡ纯软件方法,VHDL方法和NiosⅡ自定制方法。其中,VHDL描述方法的实现采用了基于单精度浮点数的加法器模块、乘法器模块、二进制和浮点数的转换模块,并对定点数和浮点数在不同阶数下的资源消耗进行了对比。该设计不仅提高了运算精度而且扩大了数据的运算范围。采用NiosⅡ自定制方法比NiosⅡ纯软件方法实现提高了运算速度,而且这种优势在阶数越高的情况下越为明显。最后通过实验将设

 

 

变流器数字控制系统中基于IP软核的DSP,MCUFPGA芯片间的数据通信技术

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针对变流器数字控制系统的DSP,MCUFPGA芯片需要快速、可靠地完成一定数据量通信的要求,基于FPGAIP软核实现双口RAM方法,研究适用于MCU,DSPFPGA芯片间的数据通信技术。首先利用Altera公司提供的FPGA开发环境Quartus中的MegaWizard进行配置,实现1个双口RAM模块;基于该模块,依次设计单向三口RAM模块、双向三口RAM模块以及双向三口RAM模块与MCUDSP芯片的接口部分,并将带有与MCUDSP芯片接口的双向三口RAM模块封装

 

 

基于FPGAP-HIFU相控信号发生器研制

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现状的分析,讨论并确定了控制接口方案,以及基于FPGA技术的相位信号生成方案。本文设计了相位信号发生器中FPGA固件的架构体系,并使用VHDL代码或现有IP核实现了固件的编码。本文在FPGA固件中加入了嵌入式的MCU,并编写了相应的软件代码,实现了先下载存储相位数据,后顺序输出相位信号的运行模式,该模式实现了加热焦点的快速移动。本文在FPGA的固件中,加入了PCIIP,用户可以将相位信号发生器作为PCI插卡,插入到工控机的PCI插槽中使用,实现了实时的加热焦点快速移动的

 

 

基于FPGA的独立光伏发电系统控制策略的研究

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能源面临危机,但经济依然要发展,对新能源的研究成了热门话题。太阳能发电因其储量丰富、洁净能源等特点得到广泛关注。但在太阳能发电研究的初期还面临着诸多的问题,如光伏电池成本高,发电效率低等,这些问题严重制约着太阳能发电的发展。提高太阳能发电的效率、降低成本是目前情况下解决这些问题的主要途径。本系统为独立光伏发电系统,其中每一部分的控制可以相对独立,因此采用FPFA作为控制器,将每一部分作为一个模块并行控制,提高系统的速度。在PVsyst软件中对系统整体进行分析;在Pspic

 

 

基于FPGA的新型单段光纤爆速仪设计

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受到一定的限制。应靶场要求,本文设计了一个基于FPGA的单段光纤爆速仪,采用光纤作为信号获取探针,FPGA实现高精度计时,计时最小分辨力可达10纳秒。本文给出了爆速仪的详细设计方案。爆速仪由光纤探针、光电转换模块、触发模块、靶距输入模块、FPGA模块、LCD显示模块等组成。光纤探针对爆轰产生的光辐射信号采集并传输,经光电转换及后续相关电路处理后,将测试结果直观地显示在LCD上。FPGA逻辑电路实现计时及相关接口电路的控制,由计时模块、靶距调理模块、除法器模块、BCD码制转换

 

 

基于FPGA的高精度科学计算加速器研究

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探索了FPGA平台加速高精度科学计算应用的能力和灵活性.首先,研究科学计算中最常用的操作——向量内积,提出基于定点操作的精确向量内积算法.IEEE 754-2008标准的四精度(Quadruple Precision)浮点算术为例,FPGA平台上设计了一个基于全展开方法的全流水四精度浮点乘累加单元(QPMAC):提出两级存储策略精确存储乘累加和;采用保留进位累加策略减少定点加法器位宽、简化进位处理、优化关键路径;引入累加和划分策略,实现流水吞吐率.最后,XC5VLX3

 

 

基于FPGA的驾驶员疲劳检测系统研究

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波长和940nm波长的反射光,人眼瞳孔可以反射90%850nm的红外光,却只能反射40%940nm的红外光,利用此现象得到两幅眼睛以外区域亮度接近的红外图像,再对两幅图像进行位置校对,差分得到瞳孔明亮,背景黑暗的驾驶员脸部图像,有效降低了后续处理的复杂度;为了满足系统实时性的要求,采用了具有高并行处理能力的FPGA芯片,在单一的FPGA芯片内设计视频信号的控制与处理,实现驾驶员眼睛闭合情况的实时监测。本设计为驾驶员疲劳检测提供了一个可行性方案。

 

 

基于FPGAGPS接收机相关器研制

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本文主要进行了基于FPGAGPS接收机相关器研究。文章首先简单介绍了GPS定位原理,并对卫星导航电文及卫星信号的构成做了分析。接着从GPS接收机基带信号处理出发,对GPS信号捕获、载波跟踪、码跟踪方案做了深入分析。采用了超前滞后码跟踪环,并使用了四相频率跟踪环和跟踪锁相环中的科斯塔斯环(Costas)来实现FLL+PLL的载频同步,载波跟踪环滤波器使用了2FLL辅助的3PLL滤波器。基于FPGA进行相关器的研制是论文的重点内容,重点讨论了GPS接收机相关器的总体设计方

 

 

基于FPGA携带式心电异常预警系统的设计与实现

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电异常预警设备携带性,实时性等需求,本文采用了FPGA为硬件开发平台,Verilog HDL硬件描述语言进行了结构化设计和编程,Modelsim软件和Debussy软件进行了仿真测试,LabVIEW软件编程搭建功能验证平台进行了对比验证。本文实现了集心电信号的滤波、心电波形显示、心率显示、异常心率预警、异常心电数据存储等功能为一体的携带式心电异常预警系统。首先本文提出了采用数字滤波器来代替模拟滤波器对心电信号进行实时处理。在传统的心电信号预处理电路中,通常在前端加入模拟电路

 

 

基于Virtex-5FLASH实现FPGA的多重配置

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基于软件无线电平台对FPGA程序加载使用需求,设计了一种FPGA程序重加载电路,分析了软件流程。采用EDA技术,Virtex-5系列现场可编程门阵列(FPGA)为核心电路,配合外围存储芯片,ISE软件中运用VHDL硬件描述语言对FPGA进行编程以实现设计功能,对功能进行了仿真验证。采用上述方式实现了程序重载的灵活控制。

 

 

PXI模拟信号输入/输出模块

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为电子设备和系统提供多个通道的信号源;同时,在FPGA中实现逻辑电路的设计,根据上位机通过PXI接口发送过来的命令,控制整个模块的工作以及各单元电路之间的数据传输。本文阐述了PXI模拟信号输入/输出模块的硬件设计,包括模拟信号输入通道设计、模拟信号输出通道设计、数据存储电路设计、PXI接口电路设计及FPGA逻辑设计等,其中着重阐述了FPGA逻辑电路的设计。FPGA逻辑设计主要包括了PCI9054本地接口逻辑的实现、DDR2SDRAM控制器实现、A/D采集数据的接收和存储、以

 

 

基于FPGA的时钟频率动态重置算法研究与应用

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OM空间、与用户交互性不强的问题,提出一种基于FPGA的频率动态重置改进型算法。动态重置端口(DRP)与加强型MMCM原型连接,采用状态机来驱动DRP,顺序实现读取输出端口寄存器地址、读取分频值、使能端口寄存器读写等功能,以达到软件动态改变电路模块工作频率的功能。然后,我们设计了一个用户可控的频率动态重置系统,用户在电脑终端直接输入电路模块序号和频率值即可改变相应模块的工作频率。该系统主要由处理器软核MicroBlaze连接电脑和动态重置模块BeatMaster而成,Bea

 

 

基于FPGA的信号质心硬件解算程序设计

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文章是对基于FPGA的信号质心的解算程序进行设计;FPGA作为数据处理及控制中心对信号进行解算处理和控制各种时序;本系统采用VHDL语言编写程序,要解算信号的质心,首先要对从AD转换得到的数据进行处理,然后FPGA对这些数据进行累加及乘积累加处理;以将解算结果按优先级顺序实时写入FIFO中去,最后通过网口将已处理的数据输出到计算机中;程序经过仿真测试后表明,可用FPGA对信号进行求取质心的运算。

 

 

基于FPGA的线性调频定距系统设计

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针对毫米波调频测距系统,设计了在距离门基础上以FPGA为核心的信号处理电路的硬件与软件,最终实现0-20m范围的定距功能。论文首先讨论了三角波调频信号发射频率f0、频偏ΔF、调制频率fm的计算和FIR数字滤波器的基本理论。然后介绍系统核心芯片Xilinx XC3S400的选择及硬件电路的设计。软件设计部分主要包括5通道FIR滤波器的3dB带宽、最小阻带衰减等参数指标的确定,调用Matlab滤波器设计函数firlKaiserord获取满足指标要求的FIR滤波器的抽头系数h(

 

 

基于FPGA的数据采集系统设计

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外界物理世界联系的桥梁,是获取信息的重要途径。以Xilinx公司的Spartan-3系列FPGA芯片XC3S400为核心,采用TI公司的TLC0820型号的A/D转换器作为模数转换器件,设计了一个基于FPGA的数据采集系统,并用Verilog HDL语言作为描述语言实现了对TLC0820的采样控制和FPGA的数据处理等过程的控制,Xilinx ISE 9.1i软件为平台,进行了设计输入、分析与综合、仿真与验证等过程仿真实现了这一系统。

 

 

基于FPGA实现的可变模全数字锁相环

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变模分频器,使得中心频率可变,锁相范围增大;通过前馈回路进行鉴频调频,提高了锁相速度;同时其环路滤波器采用比例积分结构,使得锁相输出无静差,输出抖动减小。本文对提出的全数字锁相环建立了小信号模型,从理论上分析了该锁相环的性能以及控制参数对锁相环性能的影响,通过基于QuartusⅡ的软件仿真和基于FPGA的硬件实验对该全数字锁相环的性能进行了验证。结果表明,该全数字锁相环锁相范围大、速度快、精度高,可用于有快速同步需求的应用场合,如电网频率监测和并网变频器控制。

 

 

基于FPGA51单片机信号发生器设计与实现

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为了降低传统函数信号发生器成本,改善函数信号发生器低频稳定性,本文结合FPGA51单片机设计并实现了产生以0.596Hz频率精度各种函数信号。函数信号频率、波形、幅度由51单片机控制,并用LCD显示函数信号相关信息。本文设计的信号发生器易维护、可以软件升级,从而得到更高频率精度的函数信号满足不同场合设计的需要。

 

 

基于FPGAAIS基带数据处理芯片设计

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当今,航运事业蓬勃发展,海上船舶的航行安全越来越重要,这需要可靠性和稳定性更高的通信设备。船舶自动识别系统(简称AIS)能在VHF无线电工作范围内发送静态、动态以及航行信息,确保船舶之间互相跟踪监视,提高了船舶的海上航行安全。AIS系统主要包括岸台基站和船站,本课题的研究对象是船站系统。船站系统中主要由天线、射频模拟部分以及AIS数字基带信号核心处理芯片等组成。AIS数字基带信号处理芯片主要实现发送数据的HDLC协议编解码,物理通信链路中信息的GMSK调制解调等功能。本研

 

 

基于FPGA的改进粒子滤波算法实现

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,算法实时性不高,且对实时系统需求更多的资源。FPGA拥有强大的并行运算能力,且实现方式灵活。本文研究目的是基于FPGA硬件平台实现粒子滤波算法,通过降低粒子滤波算法的复杂度,优化硬件结构,提高运行速度,合理利用硬件资源,在保证滤波性能的前提下,设计出一款运算速度快、硬件资源占用少、性能可靠的粒子滤波器。本文首先介绍基本粒子滤波算法以及改进型粒子滤波算法,针对粒子匮乏引入一些处理措施,如重采样策略与粒子平滑技术。分析了FPGA结构与工作原理,并选取Spartan-3a作为粒

 

 

一种基于FPGA的视频滤波模块的硬件实现

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在拍摄环境复杂的情况下,视频采集系统采集到的视频信号往往受到噪声的干扰,不能反映被拍摄物的真实情况。本文设计了一种基于FPGA的视频图像滤波模块,能够对采集的视频信号进行滤波处理。该模块采用Xilinx公司XC4VSX25FPGA芯片作为运算核心,实时性强。利用其强大的整合逻辑资源对视频信号运算处理,使其集中在FPGA片内,具有良好的整合性和可复用性。

 

 

数字梯形成形滤波器的FPGA实现

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针对数字梯形成形算法在FPGA中的实现问题,提出了基于FPGA的数字梯形成形滤波器的改进结构。通过SIMULINK仿真和基于FPGA的实验验证,证明了改进后的基于FPGA的梯形成形滤波器能够灵活地调节梯形信号上升时间和平顶时间参数,并且扩展了在不同核辐射探测器和信号调理电路配置条件下的多道脉冲幅度分析器测量范围。

 

 

软件无线电数字下变频器的设计与FPGA实现

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详细的阐述。然后基于这些理论的研究,设计了基于FPGA的数字下变频器。其性能指标为,最大输入数据速率(等于输入信号采样率)fs85Msps,最大系统处理时钟fPRO85MHz,信号带宽为2MHz,输入数据位宽为16bits,输出数据位宽为26bits。本数字下变频器从结构来说主要由两部分组成,即数字混频模块和抽取滤波模块。抽取滤波模块又由三部分组成,5CIC抽取滤波模块完成8倍抽取功能,2HB抽取滤波模块完成4倍抽取功能,FIR滤波模块完成整形滤波功能。论文对各个功

 

 

基于FPGAPROFIBUS-DP从站研究与实现

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的一个标准当属PROFIBUS-DP。本文拟用FPGAField Programmable Gate Array)设计实现DP从站功能。首先研究了PROFIBUS-DP相关协议,接着对设计中用到的FPGAVerilog硬件描述语言进行深入学习。参照常用的从站协议芯片SPC3SIEMENS PROFIBUS ControllerVersion3)的结构,并结合FPGA自身的特点和DP从站需要完成的功能,本文给出了从站的整体模块结构。这个设计将从站分为3个功能模块:物理

 

 

基于多DSPFPGA的实时图像处理系统设计

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为解决高速数字图像处理系统和实时性相冲突的要求,设计了以多DSP(数字信号处理器TMS320C6416)和现场可编程门阵列(FPGA)相结合的实时图像处理系统。重点介绍了该系统的硬件资源选择、基本组成、工作原理、电源设计、DSP引导方式以及软件设计等,通过对每秒2514640×512像素的数字图像处理结果表明,该系统满足高速图像实时处理的要求。同时,可扩展到更高速度的DSP(TMS320C6455系列),实现更为复杂的实时图像处理任务。

 

 

基于FPGA盲均衡器的研究

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道突变情况下的收敛速度和收敛误差。其次,介绍了FPGA的设计流程,ISE9.2软件环境下,Verilog HDL语言采用自顶向下的数字系统设计方法实现了恒模算法的盲均衡系统,详细介绍了系统的总体结构框图,对总体模块进行了功能介绍,给出了滤波器模块、判决模块、误差模块和系数更新模块四个分模块的结构框图和具体设计。最后首先用了ModelSim SE6.0测试软件对设计的盲均衡系统进行了仿真验证,然后在XUP Xilinx Virtex- Pro开发板上对均衡器进行仿真测试

 

 

FPGA在坦克炮控系统中的应用研究

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路为研究对象,以可编程逻辑器件现场可编程门阵列FPGA为硬件基础,进行了用FPGA逻辑控制功能代替炮控系统继电逻辑控制的研究,分析了坦克炮控系统逻辑电路的功能和FPGA的原理,提出了系统设计的总体方案,设计了系统硬件电路和逻辑控制软件程序,并在逻辑控制软件中加入了故障诊断功能。坦克炮控系统逻辑控制采用软件实现,FPGA中实现继电逻辑控制功能,简化了坦克炮控系统逻辑电路,完成了坦克炮控系统逻辑电路的数字控制,系统中嵌入的故障诊断功能为系统在线故障诊断提供可能。

 

一种基于FPGACCD图像传感器驱动系统设计

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针对CCD图像传感器ICX274驱动信号产生中已有驱动电路设计的某些不足,提出一种基于时序生成芯片CXD3609R的新方案,并设计了基于FPGA嵌入式平台的CXD3609R电路,以此实现对ICX274驱动信号的产生。实验结果表明,CXD3609R能够产生满足ICX274所需的时序驱动,验证了本设计系统的可行性,这为基于ICX274的成像系统的设计提供了一种新思路,并为后续的成像系统研究设计奠定了基础。

 

 

基于FPGA的高速数据采集系统的设计与实现

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据量大、实时性、传输速率等问题,提出了一种基于FPGA的高速数据采集系统的实现方案。该方案以FPGA作为主控芯片,实现模拟信号通道的可控、A/D转换控制、DDRII SDRAM数据缓存、PCI总线数据的传输四个主要功能,系统采用Verilog HDL语言,通过Quartus II 6.0软件编程来实现IP核的控制,从而实现多个ADC08B200芯片进行数据采集,通过DDRII SDRAM进行数据缓存,将数据通过PCI总线传输到PC机。系统经过PC机的测试软件,能够很好地完成

 

 

LED大屏幕同步控制系统的设计

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块接收卡组成,发送卡主要由DIV视频解码模块、FPGA控制模块、双SDRAM乒乓缓存模块、以太网络发送模块等模块组成;接收卡主要由以太网络收发模块、FPGA控制模块、SDRAM缓存模块、LED扫描驱动模块等模块组成。根据系统的具体方案,本文首先对系统的主要器件进行了选型分析,接着对系统的硬件原理图设计进作了详细的介绍,并针对本系统的特点与要求对PCB的设计提出了一些解决方案。为了提高LED大屏幕显示图像质量,提高视觉效果,本文在FPGA里面设计了视频数据的反γ矫正与灰度等级

 

 

基于FPGA的基带物理层网络编码的研究

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系统。并将搭建的三节点网络的通信系统简化在两块FPGA开发板上实现。在设计方案中,交换信息的两个节点利用BPSK方式进行调制,中继节点发送的信息利用BDPSK方式进行调制,中继节点的解调映射按照基于BPSK调制的物理层网络编码的解调映射原则进行处理,载波同步利用科斯塔斯锁相环原理进行设计,位同步依据全数字微分整流型锁相环原理进行设计,帧同步采用集中插入式巴克码原理进行设计。在XilinxISE10.1开发环境下,采用Verilog硬件描述语言进行了交换信息的两个节点的组帧

 

 

准循环低密度奇偶校验码译码器的FPGA设计与实现

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最小和译码算法作为译码算法在Xilinx公司的FPGA上进行实现。首先,介绍T-MMB手机电视标准的相关背景知识以及LDPC编码的基础知识。其次,研究几种软解调算法与LDPC译码算法。在性能以及硬件实现复杂度等方面对各种算法进行分析比较,最后确定将最大值算法与归一化最小和算法分别作为软解调以及译码算法进行相应硬件实现。并对整个系统在Matlab中建立仿真模型进行仿真,得出译码性能,为后续设计实现提供理论基础。最后,给出整个译码器的FPGA设计系统方案以及各个模块的实现。包括

 

 

基于FPGAARM的多路时序控制系统设计与实现

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介绍了基于FPGAARM7的多通道、多时间范围的同步时序控制系统,采用FPGA实现20路高精度的信号延时输出控制,通过ARM7的数据总线接口实现了ARMFPGA的数据交互;重点介绍了系统的硬件电路设计、ARMFPGA总线的设计和FPGA内部程序模块的设计;各通道的输出信号类型与延时时间等参数均可以通过人机接口现场配置,也可以通过上位机软件来配置;该设计可以保证各通道信号通过外触发信号为基准来进行延时输出,系统的延时时间精度小于2μs;ARM7处理器芯片采用PHILIP

 

 

Xilinx FPGA上电时序分析与设计

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提出了由于FPGA容量的攀升和配置时间的加长,采用常规设计会导致系统功能失效的观点。通过详细描述Xilinx FPGA各种配置方式及其在电路设计中的优缺点,深入分析了FPGA上电时的配置步骤和工作时序以及各阶段I/O管脚状态,说明了FPGA上电配置对电路功能的严重影响,最后针对不同功能需求的FPGA外围电路提出了有效的设计建议。

 

 

脉冲发生器波形产生模块的设计与实现

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续调动的满足各种激励需求的信号源。本文主要是在FPGA内部搭建脉冲发生器的波形产生模块,产生幅度、脉冲参数可以调的脉冲波形。首先介绍了脉冲发生器研究的意义和价值;其次是介绍设计中整体方案的设计思想,模块搭建原理;再次是详细介绍在FPGA内部功能模块的详细电路图设计和仿真;最后介绍设计方案中其他部分器件的选择和仿真调试。本设计方案的思想是ARM+FPGA, ARM作为控制部分,FPGA作为脉冲波形的产生部分。通过阅读国外成品脉冲发生器仪器的资料,提出设计方案,对设计方案进行原

 

 

基于FPGA的嵌入式Web服务器设计与实现

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ernet发展的一种趋势。本系统主要研究了基于FPGA的嵌入式Web服务器的构建技术,并以此为基础实现了基于Web网页控制的分形图生成器,完成了在FPGA板载TFT显示屏上进行Mandelbrot集和Julia集的分形图生成和显示。以Xilinx公司的现场可编程门阵列(FPGA)作为硬件平台,借助ISEEDK开发工具搭建了包含TFT显示控制和嵌入式Web服务器的SOPC系统。本系统在Xilnet协议和Xilmfs文件系统等软件基础上,采用TCP/IP套接字编程技术,实现P

 

 

FPGA在多轴步进电机控制器中的应用

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提出一种应用现场可编程门阵列(FPGA)实现多轴步进电机控制器的方法。采用IP设计思想,步进电机的运动控制由硬件电路(步进电机IP)实现,轨迹计算由同一芯片上的微处理器(NiosⅡ软核)实现,从而可以构建多轴步进电机控制器的可编程片上系统(SoPC系统)。利用VHDL硬件描述语言,设计了一种高性能步进电机IP,并进行了仿真验证。为了验证该IP核的复用性,构建了一个4轴步进电机控制器的SoPC系统。实验结果表明,此系统可对多轴步进电机实现高精确度控制,每轴的运动是相互独立

 

 

嵌入式软核CPUFPGA实现和比较研究

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则需要投入较多的资金,承担较大的试制风险。而用FPGA来实现SoC的功能就可以降低或规避风险。嵌入式CPU是嵌入式SoC的核心。嵌入式CPU种类繁多,选择款好的处理器是开发SoC的重要步骤。性能是选择嵌入式CPU的重要方面,性能测试则是开发嵌入式SoC的重要部分。目前在SoC设计中广泛使用的32RISC处理器,如ARM处理器和MIPS处理器均属于商业内核,使用者必须支付相对昂贵的授权费。考虑到软核的灵活性和可剪裁性,本文选择四款免费的嵌入式微处理器软核进行性能比较,它们分

 

 

基于FPGA的电子式互感器智能合并单元研制

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的基础上,描述了一种基于现场可编辑逻辑门阵列(FPGA)的电子式互感器智能合并单元的具体实现方法。根据FPGA的模块化编程和多任务处理的特点,该方法在单片FPGA内实现采样脉冲同步,数据采集,采样值处理,以及以太网控制芯片驱动和数据帧发送。本合并单元能够传输符合IEC61850-9-1IEC61850-9-2规约的数据帧,两种数据帧的传输可以根据实际需要进行切换。运用MMS Ethereal软件对本合并单元发送的数据帧进行捕获和分析,结果表明该合并单元具有较高的灵活性和较

 

 

水质在线监测系统的研究与设计

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监测系统当中,伴随着EDA技术的发展,因而使得FPGA的应用不断的得到发展和应用,使其应用在通信系统中,从而应用在水质监测中。本文,对水质在线监测进行了系统的设计及研究和验证,基于了Profibus-DP,FPGA等硬软件,本文的工作内容包括:第一:对水质监测取水系统进行了分析,设计出了一套取水方案;第二:针对FPGA的工业应用,设计了一个基于FPGAPROFIBUS的通信协议芯片,并且根据FPGA的自顶向下的设计方法,完成了设计;第三:FPGA在系统中,是一个现场数据采

 

 

 

基于FPGA的出租车计价系统设计

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设计出租车计价系统,运用自顶向下的设计思想,以芯片CycloneEP2C8T144C8为设计核心,采用QuartusⅡ仿真软件,对设计电路的各模块及整个系统进行了EDA仿真验证。结果表明,该计价系统具有计时、计费、计程和动态显示的功能,符合设计要求,修改VHDL语言源程序,可完成更多的出租车计价系统的扩展功能。

 

 

基于FPGA和多DSP的多总线并行处理器设计

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设计了一种用于目标识别与定位的基于FPGA和多DSP的多总线并行处理器,其特征在于将FPGA作为系统数据缓存、通信与控制中枢,以此为核心,通过数据与控制总线联接端口控制CPLD芯片,通过EMIF总线分别联接DSP(A)DSP(B)DSP(C)处理芯片;端口控制CPLD芯片的输入端联接多路并行ADC模数转换芯片,输出端口联接LCD输出显示模块;有源晶体振荡器与FP-GA芯片联接,FPGA芯片将有源晶体振荡器分为4路时钟信号输出,分别输出到CPLD3DSP芯片;设计改进

 

 

 

 

一种解线性最小二乘问题的FPGA计算方法

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针对基于FPGA实现解线性最小二乘问题存在的计算并行性差和计算延迟大的问题,提出基于改进Cholseky分解解线性最小二乘问题的FPGA计算方法。该方法将最小二乘问题转换为矩阵分解和三角阵求解两部分实现,在每个部分通过最大化PE单元数量提高运算的并行性。在矩阵分解部分采用改进的Cholesky分解方法规避开方运算,并将除法运算转换为乘法,减小计算延迟。同时,在三角阵求解部分通过计算结构复用实现正三角和倒三角线性方程组的求解,提高资源利用率。在Xinlinx Virtex X

 

 

Ising模型的数值模拟及FPGA实现

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法对Ising模型的研究结果进行分析和总结,用FPGA设计和实现了Ising模型的元胞自动机模拟,并对实验结果进行了对比分析。论文首先介绍了近几年国内外Ising模型的研究现状和一维、二维模型的精确解,分析了在研究三维Ising模型精确解过程中遇到的困难,并用蒙特卡罗数值模拟方法和重整化群方法对Ising模型研究结果进行了总结。其次研究了Ising模型的元胞自动机数值模拟。系统阐述了元胞自动机及对物理系统的模拟,详细介绍了Ising模型的元胞自动机模拟的原理和方法,对用软件

 

 

高清视频光纤传输系统

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可以采用高带宽、低损耗、抗干扰的光纤传输系统。FPGA作为高灵活性的可编程逻辑门阵列,如今已经渗入到通信、视频、医疗影像、消费品等多个领域,片上集成有丰富的逻辑门、存储器、DSP模块、吉比特收发器、时钟资源、内嵌的PowerPC/ARM核可实现各式各样的逻辑控制、算数运算,内部逻辑在时钟驱动下并行性执行操作使得它比其它通用处理器执行速度更快。利用硬件描述语言对内部逻辑的修改和复制,极大方便了工程人员设计开发的需要。FPGA在视频图像领域已经成为一个重要的处理器件,它可以处理

 

 

基于FPGA电子稳像技术的研究

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和背景中存在小运动物体的情况。设计和实现了基于FPGA的电子稳像系统。本文的具体研究内容如下:首先,在分析了电子稳像的原理、一般系统组成和电子稳像的评价方法的基础上,结合各种稳像算法的特点,设计了本文所要研究的基于FPGA电子稳像系统的总体架构图。接下来,重点研究了本文所采用的灰度投影稳像算法。采用Matlab作为算法的研究平台,按照预处理、灰度投影、投影滤波、运动估计、运动补偿的流程对算法进行研究分析;针对传统灰度投影算法只能检测水平和垂直方向上的位移矢量,对算法进行了改

 

 

基于FPGA局部动态可重构技术的可靠性系统实现与优化

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随着半导体工艺技术的不断发展,基于SRAMFPGA芯片内部的硬件逻辑资源规模不断扩大,因此对其可靠性要求也不断提高。三模冗余技术是一种由三个完全相同的复制电路模块及一个多数表决器构成的具有容错功能的电路结构,该技术可以为系统电路提供较高的可靠性,但需要使用大量的额外硬件资源实现,造成面积冗余问题。局部动态可重构技术是一种可以实时修改FPGA中局部电路功能,并且不会影响其电路其它部分的新技术。将局部动态可重构技术应用到传统的三模冗余结构电路中,可以有效地解决面积冗余问题,然

 

基于FPGA的高速二维DCT变换的研究与实现

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此需要对图像数据进行星上压缩处理后再进行传输。FPGA具有低功耗、高性能的特点,已普遍应用在卫星的各种有效载荷上,因此可采用FPGA实现图像压缩。基于FPGA的图像压缩算法的核心是DCT变换,DCT变换中需消耗大量的乘法资源。为了提高图像压缩的效率,同时减少对专用乘法器的依赖,本文就充分利用FPGA中的BRAMLUT资源,使用改进型的分布式算法、流水结构和乒乓操作,在避免使用乘法器的同时,实现JPEG压缩算法中的DCT变换,具有良好的可移植性。经验证,该方法用于基于

 

 

基于FPGA控制的DC-DC变换器的研究

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DC变换器数字控制的研究,设计并实现了一台基于FPGA控制的Buck DC-DC变换器。在分析研究了多种控制方式的基础上,根据Buck变换器的稳态和动态性能,设计了数字滞环电流的控制策略,并对数字滞环电流控制下Buck变换器的负载突变和启动过程中输出电压的动态响应进行了详细分析。根据所设计数字电源的技术要求,完成了Buck变换器的主电路元件参数设计,功率开关管驱动电路的设计、采样电路的设计、FPGAA/D转换器的选型及外围电路的设计。在Matlab/Simulink环境中

 

 

基于FPGA的以太网MAC控制器的实现

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以太网IEEE802.3协议根据LAN的特点,把数据链路层分成LLC(逻辑链路控制)MAC(介质访问控制)两个子层.MAC层协议作为数据帧收发的基础,是以太网技术的核心,主要负责上层数据和物理层的数据流量控制和数据流的检测、校验工作.介绍了基于FPGA10MHz/100MHz以太网MAC控制器的设计,整个设计用Verilog语言实现.自主设计开发验证板,使用Altera厂商的FPGA(EP1C20F400C8)并验证.

 

 

无线信道高速传输的均衡技术及FPGA实现

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决造成严重影响,需要研究特殊的手段来解决,并在FPGA内实现。本文研究航空无线信道的抗多径干扰技术,主要为信道估计,和信道均衡技术。本文主要工作如下:1.在研究航空多径信道的基础上,参考常见抗多径处理方法,提出一种解决航空信道大时延强多径干扰问题的算法,即基于伪码相关的时域信道估计,和基于导频重构、判决反馈的时域均衡方案。2.FPGA内实现基于导频的信道估计和均衡方案,考虑精度要求,做采样间隔的信道估计和均衡,在FPGA片内成功解决多径干扰问题。3.系统各模块编写、测试,

 

作者:网络 来源:网络
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