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FPGA常用算法列举004——5

时间:2014-5-16 20:38:56 点击:

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基于FPGALVDS高速数据通信卡的设计与实现

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者是模拟产生设备交付测试时的前端输入信号。基于FPGALVDS高速数据通信卡是遥测模拟信号源的一个组成部分。论文根据通信卡的功能和技术指标,详细阐述了LVDS高速数据通信卡的设计与实现。论文首先介绍了选题的背景和意义,并提出了课题的研究指标,随后介绍了系统研发所涉及到的关键技术背景:LVDS信号、PCI总线原理、FPGA应用开发和DDS技术原理。然后在论文中从硬件、逻辑和软件三个方面介绍了系统的详细设计方法。硬件部分主要包括总体设计、模块划分、模块原理图设计,最后进行印制

 

 

LTE系统中编码调制技术的FPGA设计与实现

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理论意义和商业价值也越来越明显。本文主要是使用FPGA实现LTE下行链路中的调制解调和编码译码,并将综合后的链路模型下载至Xilinx硬件开发板以实现其通信功能。论文首先对LTE下行链路结构作了简单介绍,并对需要实现的模块做了分析和研究,制定可行的实现方案。其次,调制解调选取16QAM,编码译码选取Turbo,使用硬件描述语言实现,对各模块的基本功能进行仿真。然后将仿真通过的各模块综合并下载至硬件开发板上,使用示波器观察各模块实际输出波形,对比软件仿真图,确保模块正确性。最

 

 

基于FPGADBS实现

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成像的基本原理,结合当前基于现场可编程门阵列(FPGA)实现数字信号处理的能力,本文对DBS成像系统的FPGA实现方法做了深入探究。该系统设计将DBS成像算法映射到FPGA硬件系统中进行实现,结合重新时序分布、展开与合并等算法实现技术,同时注重流水线、并行处理等基本设计技巧,解决了FPGADSP协同处理等关键问题,极大地提高了DBS成像系统的运算精度和运算速度。通过雷达实时实验数据仿真验证,设计的系统具有实时高性能的特点,可以很好地满足实时DBS成像要求。

 

 

基于FPGASHA-3五种候选算法设计实现

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,并在Xilinx Virtex- Pro FPGA开发板上进行了实现与验证。通过对五种算法实现结果进行对比分析,我们发现:优化前,Gr(?)stl占用的面积最小,仅为1892slice,运算速度最快的是Keccak算法,能达到8568.51Mbps;优化后,Keccak算法的运算速度仍是最快,并提高到了8738.88Mbps,Skein所占用的系统资源最少,3950slice;平衡考虑系统资源占用和速度两个因素,五种候选算法中Keccak算法整体性能表现最佳。

 

 

基于MSP430FPGAMODIS信号基带数字接收模块的设计与实现

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要。针对于此,本文提出基于MSP430单片机和FPGAMODIS信号基带数字接收的开发,通过基带的解调、解码等技术来恢复MODIS原始数据。本文的主要研究工作有以下几点:1、针对MODIS信号的数据格式和卫星发送端的处理过程,结合卫星通信系统的知识,提出了一种MODIS信号的接收方案。阐述了MODIS信号接收系统的结构组成,并重点研究基带数字接收模块的设计。2、阐述了数字基带接收技术中的模数转换、QPSK数字解调,R-S码,分组交织,卷积码编解码的原理,给出了整个基带数字

 

 

基于FPGA的交通事故实时视频检测研究

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检测不仅具有理论意义还具有很大的实用价值。利用FPGAField Programmable GateArray,现场可编程门阵列)进行视频图像处理,因为其并行处理能力、灵活、可配置等特点而受到越来越多学者的青睐。本文主要利用在FPGA硬件开发平台上搭建Nios II嵌入式系统来实现交通事故实时智能检测,主要包括目标检测、目标跟踪、碰撞检测和事故报警。论文的主要研究内容如下:1、论述了在FPGA硬件平台上使用Nios II搭建SOPC嵌入式系统的意义;同时介绍了Nios I

 

 

基于卫星通信的高速纠错码研究及其FPGA实现

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由于其码字长、码率多,不易于硬件实现。本文针对DVB-S2LDPC码庞大的资源消耗和较低的数据吞吐量进行分析,在尽量不影响其性能的前提下,设计了一种基于最小和算法的高速译码器的FPGA实现方案。该方案采用180路并行,6bit位宽,20次迭代,在降低资源消耗量的同时,最高可支持208.9MHz的时钟,数据吞吐量可达340Mbps。论文基于Xilinx SC5VSX95T芯片,通过开发板下载测试,验证了其优越性。另外,该译码器方案还可以兼容其它第二代DVB标准。

 

 

H.264去方块效应滤波器的FPGA设计与优化

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的硬件设计与实现。本文首先分析了视频编码技术和FPGA技术的发展,详细介绍了H.264去方块效应滤波器的工作原理,这是本文研究的理论基础。进而在不改变滤波结果的前提下提出了对此模块的设计优化思路:对滤波中间数据进行缓存,减少对外部存储器的访问次数和数据总线的占用,加快滤波速度;在对4x4子块间相关性进行研究和分析的基础上,采用了便于硬件实现的滤波顺序;设计了数据的输入输出方式,数据的输入顺序更符合改进的滤波顺序,能够减少中间数据的存储,数据的输出采用9种模式,有利于完成滤波

 

 

基于M元扩频的岩层通信系统研究与FPGA设计

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,Eb/No=7dB,信令捕获概率达到95%以上。3.设计了一种脉冲成形波,该脉冲波形具有占空比小、峰平比高、瞬时功率大、驱动能力强等特点,适合于复杂的地下岩层介质信道特性4.完成了发送端与接收端FPGA模块的设计,发送端主要包括M元双正交扩频、RS编码、波形成形和信令发送等模块,接收端主要包括匹配滤波、信令捕获、解扩和RS译码等模块,并完成了各模块的功能仿真与时序仿真。5.完成了FPGA的部分测试工作,验证了FPGA各模块的功能。

 

 

基于FPGA的人耳听觉频率特性仿生研究

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后,参数改变,其滤波电路也要重新设计,给电路的反复设计带来了很大的不便。本文通过研究人耳听觉的生理结构,采用听觉数字滤波器组技术,以一组Gammatone滤波器仿真人耳基底膜的频率特性,并在软件仿真可行的基础上,提出用FPGA实现Gammatone滤波器的方法。系统整体设计用VHDL语言完成,最终配置到FPGA中,在SignalTapII中进行在线测试,验证设计的可行性。相比于模拟滤波器的设计方法,这种数字化设计具有抗干扰能力强,调试周期短等优点。

 

 

十字路口智能交通灯控制系统的FPGA实现

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针对现实中越来越严重的城市交通拥堵现象,提出了一种城市十字路口交通信号灯控制与FPGA实现的新方法。解决了各车道车流量不均衡所造成的十字路口交通资源浪费问题,设计的智能交通控制系统利用对相向车道采用不同步的红绿灯信号控制方法,能够减少交通资源浪费,大幅提高十字路口的车辆通行效率。

 

 

软件无线电中信道化技术的研究及其FPGA硬件实现

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构与传统的并行接收结构相比运算量和对硬件资源的要求得到了大大降低。提出了2M信道的等波纹法设计原型滤波器的方案,其原型滤波器可以达到重构要求,最后通过MATLAB仿真验证其正确性。针对数字信道化技术的FPGA实现,本文对相关的技术进行了研究。最后利用EP2S系列开发平台实现了实信号多相滤波器组均匀信道化,并给出了多相滤波器、抽取运算、FFT运算、信道划分以及复乘运算等模块的设计方案。仿真结果表明,该接收技术能够实现对中频信号的正确接收,验证了系统设计的可行性。

 

 

基于FPGA的电磁测量系统及其应用研究

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损检测系统的原理和应用的基础上,设计了一套基于FPGA的数据采集电路,并且引入了巨磁电阻(Giant MagnetoResistance,GMR)传感器作为磁场测量元件,主要工作如下:1.传统的电磁无损检测系统使用线圈传感器作为磁场检测传感器,但是线圈传感器测量的是磁场的变化率,在低频激励时其灵敏度较低。因此本文探索了使用GMR传感器来测量磁场。GMR传感器直接测量磁场,因此具有良好的频率响应特性。同时,GMR传感器采用芯片封装,能够极大的降低尺寸,有利于传感器阵列的设计,

 

 

基于FPGA大流量数据识别与分流系统的设计与实现

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法,论文在Altera公司的Stratix系列FPGA开发套件上设计并实现了大流量数据识别和分流系统。系统主要由网络数据接收、大流识别算法及负载均衡的分流转发三部分构成。网络数据的接收采用Marvell公司的88E1111物理芯片以及Altera公司的千兆以太网IP核实现,接收数据的同时提取报文ID信息。大流识别算法对报文进行分析,并负责对网络中大流数据进行识别。负载均衡的分流转发主要是根据大流识别的结果来调整网络数据流向,将其中容易引起拥塞的大流根据通道负载情况进行分流转

 

 

基于FPGAH.264视频压缩编码系统研究与实现

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264极高的运算复杂度对硬件的实现提出了挑战。FPGA既继承了ASIC的大规模、高集成度、高可靠性的优点,又克服了ASIC设计周期长、投资大、灵活性差的缺点,是视频编解码系统开发的重要平台。论文在深入研究H.264编码算法的基础上,采用Actel公司的CoreMP7开发板,设计了基于FPGA的视频采集与H.264编码系统。分析并提出了编码的详细流程。完成了视频采集与编码各主要功能模块的硬件设计,并对部分模块进行了FPGA实现和功能仿真。论文工作主要包括以下几个方面:1、设计

 

 

基于FPGA的闪存数据实时纠错技术的研究

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lash Memory纠错模块(ECC),并用FPGA芯片进行仿真验证。仿真结果显示并行BCH编码译码器提高了Flash Memory的纠错能力与编码效率。本文的研究内容主要包括以下几个方面:(1)首先介绍了BCH算法的发展历程,BCH码是至今为止所发现的最好的线性分组码之一,适合于对Flash Memory中的随机错误进行纠错。在此基础上,介绍了BCH码的一些相关的代数知识,包括有限域理论、 GF (2m)的构成、有限域的特征和元素的级数以及最小多项式等。在了解BCH码相

 

 

基于高性能FPGA芯片的逻辑参数库建库研究

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的。本文的主要研究工作基于在600万门的高性能FPGA项目,建立了一套可用的标准单元逻辑参数库,与此同时还建立了一套具体的完整的标准单元逻辑参数库的软件系统;另外解决了一些技术难题并且对一些关键技术进行了改进。其中针对组合逻辑电路单元的激励波形产生的方法,在项目中通过一种简单仿真的办法就能自动产生激励;对所有参数的提取方法给出了专业的方案;对电容参数提取以及功耗建模这两大部分做了详细的分析,给出了两种等效电容的模型。对所遇到的难题比如采样点偏移以及快速逼近静态工作点,给出了

 

 

基于FPGADSP原型验证与测试

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SoC设计中的硬件模块,在芯片流片之前,提前在FPGA上实现原型,通过对原型的测试,实现软硬件协同的高效验证。近几年来,FPGA技术迅速发展,在FPGA中集成了丰富的资源,如存储块、锁相环、DSP等,并且提供多种标准的I/O。使得FPGA成为原型实现的最合适的载体,通过FPGA及相应的开发工具,可以快速建立SoC原型。随着超大规模集成电路的集成度和复杂度增加,通过原型的实现及测试工作,大大缩短了超大规模集成电路的功能验证时间。此外,SoC的软件调试可以在FPGA原型上提前进

 

 

H.264变换量化和熵编码的FPGA实现与优化

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比。但与此同时,编码器的复杂度也急剧上升。使用FPGA实现的H.264编码,能够完成复杂度极高的高清视频实时编码,具有很重要的意义。本文研究了H.264变换量化和熵编码的FPGA实现与优化。首先,给出了FPGA实现DCT算法的3种设计结构,通过比较选择四级流水结构为最终的实现方法,并对重构环中的变换与量化进行了级联实现。然后,分析了CAVLC编码,给出了零跳转的优化方法和变换表格优化的方法。最后,对于非零数据CAVLC编码,提出Level编码和RunBefore编码并行的编

 

 

基于FPGADSP的嵌入式多通道数据采集与处理系统

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上海港港口集装箱堆高检测的应用需求,设计了基于FPGADSP的多通道数据采集与处理系统,对堆高检测系统中的多通道微波测距雷达中频信号进行数字化采集与处理,最终得到各通道雷达信号的频率参数。在具体的系统设计方面,本论文的研究过程分为两个阶段。在第一阶段的工作中,设计并实现了基于FPGAUSB的多通道数据采集模块,该模块将采样得到的原始数据通过USB接口传输至上位机进行数字信号处理,最终得到各通道的频率参数。该数据采集模块现已成功应用于港口集装箱堆高检测系统,模块性能理想,

 

 

基于分散隐藏策略的高容量FPGA芯核水印算法研究

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权保护仍处于探索阶段。考虑到设计和开发一个新的FPGA芯核电路需要耗费大量的时间和精力,在芯核复用过程中,芯核的所有者总是不希望设计被非法盗用。因此,FPGA芯核水印技术作为一种有效的版权保护手段已成为业界的研究热点。在现有的FPGA芯核水印技术中,芯核所有者在FPGA芯核电路模块中添加特定的版权信息来实现FPGA芯核版权保护的目的,而这些方法通常是通过某些附加约束条件来将版权归属信息集中的隐藏到芯核电路的各个独特的子空间设计模块中,最终由独特子空间中隐藏信息来验证芯核设计

 

 

G3-PLC物理层发射机的FPGA实现

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符号生成、加窗等,和相应的具体算法以及MATLAB的仿真实现;然后用Verilog语言对各个模块进行设计与仿真;最后进行原理图设计和芯片选型以完成硬件实现。其中,硬件实现部分包括数字和模拟两个部分:数字部分均用Verilog编程在FPGA中实现,模拟部分用AD9857完成数模转换并用OPA2613增强驱动能力,从而适合在电力线上传输。文章的最后对本文做的工作进行了总结和展望,提出了论文的应用和扩展方向,同时也有不足之处和需要完善的方面,为今后的研究确定了方向。

 

 

基于FPGAIIR低通数字滤波器的设计

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采用FPGA设计了一种输入8位、输出8位的级联型IIR低通数字滤波器。具体实现上,基于减小截断误差的考虑,依据设计指标首先利用Matlab进行参数的计算并进行量化,同时获得系统的幅频响应、单位冲击响应等系统基本信息。随后在分析IIR数字滤波器内部乘法器、加法器的输入输出基础上,调用QuartusII软件调试程序建立乘法器和加法器模块,依据自顶向下的设计思想搭建整体电路,并在建立顶层文件时调用已建立好的模块。测试仿真结果表明基于FPGA设计的IIR数字滤波器达到了设计要求。

 

 

基于FPGAAES算法优化与设计研究

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在这个信息化和网络化的时代,保障信息的安全和网络的安全是责无旁贷的。只有安全的网络才能保证网络生活的有序进行,机密信息不被窃取,系统不容易遭到破坏等。网络的安全性包括:网络保密性,可用性,可靠性,完整性和真实性。所以我们既要保证网络的系统和设备的安全,更要保证信息数据的安全。在现阶段,用于保证数据安全最有效的手段是对数据信息进行加密。所以研究和分析密码算法有很大的实际意义。AES (advanced encryption standard)算法作为新一代美国数据加密标准,

 

 

 

 

结合用户约束文件的高效多FPGA系统分割方法

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rogrammable Gate Array,FPGA)可配置逻辑模块(ConfigurableLogic Block,CLB)和输入/输出(I/O)数目受限难以满足大规模复杂电路系统设计需要的问题,提出了一种结合用户约束文件(User Constraint File,UCF)和单个FPGAEDA(Electronic Design Automation)设计流程,通过部分人为干涉,对多FPGA(multi-FPGA)系统进行分割的方法.应用这种分割方法,可以提高mult

 

 

QC-LDPC码设计和分层译码器的FPGA实现

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LDPC码自上世纪90年代被重新认识以来,由于其接近香农极限的纠错能力,适合快速译码的优点得到人们的广泛关注,成为信道编码领域新的研究热点,并成为下一代移动通信的宠儿。如今,LDPC码已经广泛应用于DVB-S2CMMB以及Wi-Fi等通信系统。伴随着LDPC码研究的发展,LDPC码的硬件实现也得到了快速发展。早期采用的串行结构和全并行结构都有其明显的缺点。随着QC-LDPC码的提出,充分利用QC-LDPC准循环特性的部分并行结构也随之提出。利用准循环特性,部分并行结构在

 

 

基于FPGA的数字水印算法实现

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软件实现的水印系统很难满足实时性的需求。而基于FPGA实现的水印系统可以在数字图像获取的瞬间就嵌入水印,不仅满足实时性的要求,同时也大大提高了图像的可信度。此外,基于FPGA实现的水印系统具有低功耗、可靠性高、成本低的优点,可以很容易的集成到消费类电子产品中。因此对基于FPGA的数字水印算法进行研究具有很重要的实用价值和研究意义。本文主要完成的工作有:1、通过对已有基于FPGA实现的水印算法的研究,提出一种基于HVS(人眼视觉系统)的DCT域盲水印算法,该算法利用HVS选择

 

 

LTE系统中同步和信道估计的FPGA设计与实现

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LTE作为3G4G演进的主流技术,已经得到越来越广泛的重视,目前其应用场景也在不断扩大。同步技术、信道估计与均衡技术是LTE系统接收机的关键组成部分,为系统正常工作提供了可靠保障,有效地提高了系统的运行性能。虽然目前LTE系统在积极的开发和实验中,但是仍然不够成熟。本文的重点是LTE同步和信道估计在硬件开发板中的工程实现,首先介绍了LTE系统的帧结构以及LTE系统的关键技术,包括OFDM、同步和信道估计技术的基本原理;其次分析了LTE系统硬件开发板需要实现的功能和硬件要

 

 

一种适合营级以下单位使用的AES算法的FPGA实现

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无特殊要求等优点。AES算法的这些特点使得选用FPGA来实现AES算法具有很好的优越性。在这种背景下,本文提出了一种适合用于营级以下单位的AES算法的FPGA实现。本文所做的主要工作有:1、本文介绍了用FPGA实现AES算法所用的开发工具、开发语言和所选用的芯片,接着介绍了AES算法的加密过程。针对AES算法的结构特点,本文着重阐述了AES算法的FPGA实现的总体设计框图。2、部队营级以下单位的计算机和相关设备并不先进,但其对安全性要求非常高,对成本和加密速度也有一定要求。

 

 

网络Turbo码的FPGA实现方案

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能比较。随后,本文在权衡译码性能、硬件实现复杂度及资源消耗等因素的前提下,围绕着如何提高译码器的速度,从算法改进和结构改进两方面进行了详细的讨论。在算法改进技术上,我们对Log-MAP译码算法进行了简化,很大程度上减少了Log-MAP译码算法的复杂度。在结构改进技术上,我们采用并行滑动窗方法,解决了必须接收到一帧数据才能译码的问题。我们还分析了将浮点数转化为定点数的量化问题,并通过计算机仿真进行了验证。最后我们根据简化算法给出了每个模块的FPGA具体实现方案。

 

 

数字下变频的设计及其在FPGA中的实现

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系统中的关键模块进行仿真和性能的分析,并在传统结构的基础上做出适当改进,以满足课题所要求的各项性能指标。结合本课题的性能要求,在系统建模仿真时采用傅里叶变换的方法测量信号的中心频率,以其值作为NCO的控制输入,完成对NCO的控制。该方法很好的实现了信号中心频率的跟踪,使NCO输出的本振信号随输入信号中心频率的变化而变化。通过MATLAB软件中的Simulink进行了系统级仿真,验证了方案的可实施性,并通过FPGA进行了初步的验证仿真,证明了本论文方案的可行性。

 

 

基于USB2.0FPGA的视频采集卡设计

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市场上的视频采集卡种类繁多、功能强大。本文采用FPGA+MCU的主从处理器结构,设计实现了一款二次开发方便、软硬件升级简单的嵌入式视频采集卡。本论文从研究三种广播电视制式入手,基于USB2.0协议支持的高速数据传输和FPGA控制的灵活性,给出了视频采集系统的设计方案,完成了原理图的绘制、PCB板的布局布线、电路板的印刷焊接等工作。接着把重点放在了固件程序和上位机程序的开发上,详细地讲述了设计思想、程序算法、软硬件调试、下载验证等各个方面。论文的最后,给出了实验结果分析,提出

 

 

 

基于FPGA的等精度频率计单片系统设计 优先出版

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文章首先叙述了等精度频率测量法的原理,并进行误差分析,然后用Verilog HDL语言编程设计出频率计的核心模块,结合8051单片机IP核实现了等精度频率计单片系统,并在DE2开发板上对系统进行验证。该频率计的测量范围为0.1Hz100MHz,测量全域相对误差恒为百万分之一,实际使用证明本设计具有良好的可靠性,可用于实验室或其他频率测量项目。

 

 

基于FPGA的高速AD转换

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在雷达设计中,需要对接收到的信号首先进行模数转换,其转换速度和准确性直接决定了之后FFT等运算的准确性,最终影响雷达测量精度。介绍了一种基于FPGA,利用芯片ADS7890实现一种快速14位串行AD转换,对系统的软件和硬件做了说明。硬件部分主要为ADS7890的基本外围电路以及芯片EP2C35F672C与其的控制连接,软件部分利用Quartus 8.0编程。

 

 

APF中基于FPGA的自适应谐波检测算法的研究

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技术,直接决定APF谐波补偿的有效性,因此,对谐波检测技术的研究是一个热点课题。本文在对目前谐波检测技术的研究和发展趋势进行阐述的基础上,分析了基于瞬时无功功率理论的两种谐波检测算法的优缺点,仿真比较了ip-i。算法和自适应谐波检测算法,并对自适应谐波检测算法进行了改进优化,仿真证明了该算法的性能有了很大的改进,能够满足APF中谐波检测的要求。基于FPGA实验平台,设计了一个自适应谐波检测数字系统,对其功能和时序都进行了仿真分析,并实验验证了数字系统的正确性。

 

 

基于FPGA的高帧频CCD驱动控制系统的设计

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指标。分析并实现了DALSA公司1 M像素的帧转移型高帧频CCD芯片FT50M的内部结构和驱动时序,并采用集成芯片设计了该CCD芯片的驱动时序和所需的偏压电路,进而改进了CCD芯片的偏置电压电路,采用大多数的偏置电压由SFD信号生成的方式。因此只需产生极少偏置电压即可生成所需全部偏压,这是目前十分安全的偏压解决方案,并选用了FPGA作为核心控制器件。实验表明:此设计不仅简化了电路,还具有性能好、功耗低、体积小的优点,实现了对高帧频CCD图像采集系统的驱动控制。

 

 

基于FPGA的视频监控系统

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提出了基于FPGA的视频监控系统整体实现方案。首先介绍了在FPGA中设计I2C总线配置模块对视频处理芯片进行合理的配置,然后简单介绍了视频信号的处理过程。经过处理后的视频信号通过乒乓机制存储到SDRAM缓存,最后按照VGA的时序送到显示器正常显示。本设计采用Ver-ilogHDL语言编写程序,并用Modelsim软件进行仿真,采用ISE下载到Virtex-IIXC2VP30FFG896开发板实现了视频监控功能。

 

 

基于FPGAPCI接口控制器的设计与应用

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面详细介绍了系统的实现方法,系统的逻辑实现基于FPGA采用Verilog HDL硬件描述语言进行开发,包括PCI接口控制器和PCI用户功能模块,硬件电路采用FPGA作为核心芯片加上外围串口通信电路实现,驱动程序采用WDM驱动程序模型实现,应用程序使用C++语言开发。最后对整个系统的设计进行了总结,并对系统设计可以改进和扩展的地方进行了讨论。本课题工作所完成的波特率连续可调的PCI串口通信卡应用于遥测信号控制系统中,实现了串口收发的功能,并可满足波特率连续可调的工程要求。

 

 

基于FPGADMR转发台中频模块的实现

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本文提出了一种改进的DMR数字转发台方案,采用FPGA实现中频模块。本文首先介绍了DMR通信协议的基本内容,并对中频模块的关键技术与算法进行了一定的分析,包括多速率数字信号处理,数字滤波器设计等,对其中的平方根升余弦滚降滤波器进行了MATLAB仿真。并介绍了本项目所采用的软硬件平台:Altera公司的QuartusII软件和Cyclone II系列EP2C50F484I8芯片。其次,给出了基带信号处理模块的设计与实现,其中,着重研究了基于分布式算法的滤波器实现,对DA算法进

 

 

Turbo码滑窗译码算法研究及FPGA实现

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rbo码的编译码原理,详细分析了MAP Log-MAP MAX-Log-MAP三种译码算法,并通过计算机仿真分析了影响译码性能的因素,确定了FPGA实现时采用的参数。其次对滑窗算法进行了详细的介绍,阐述了它能实现高速译码的原因。对并行译码为什么会产生冲突问题做出分析,指出可以通过设计无冲突的交织器避免冲突。最后在Quartus Ⅱ软件下编写编、译码器模块,对关键的计算模块给出了理论分析、电路原理图、顶层图及引脚定义,并在ModelSim软件下进行系统仿真。

 

 

基于FPGADSPPCI-E高速密码卡设计与实现

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ss (PCI-E)总线,以现场可编程门阵列(FPGA)和数字信号处理器(DSP)为系统的控制核心、具有多种密码算法功能的计算机外围设备——密码卡,体系结构由总线接口、控制逻辑、算法模块、数据传输和存储等几个主要部分构成。该密码卡可以提供数据加解密、数字签名以及验证签名等安全服务,保证重要信息在网络传输中的安全性。DSPFPGA是密码卡的核心控制单元,也是本论文设计的重点。在DSP方面,详细介绍了DSP与各芯片的硬件接口设计,包括DSPFPGAFlash、电可擦除可编

 

 

基于USB单片机和FPGA的信号源设计

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提出了基于USB单片机和FPGA的信号源设计方案,完成了该信号源在FPGA内部的逻辑设计,并通过USB单片机,实现了计算机和FPGA之间的通信。实验结果表明:该信号源具有精度高、稳定性好的优点,有较高的推广使用价值。

 

 

基于FPGA的机器视觉设计

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为实现系统快速更新,在此设计了一种新的机器视频解决方案,借助FPGA技术,实现视频输入端口与Gige Vi-sion IP的使用以及系统与计算机主机的连接。设计方案中采用了新的Gige Vision标准及Gige Vision IP,使系统相比其他现有相关标准更简单、速度更快,是未来的发展方向。

 

 

基于FPGA的机载视频处理与图形生成系统设计与实现

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显示飞机的外景实况和各种飞行参数画面。本文基于FPGA构建了整个系统,用于采集外部视频信号并对其进行处理,同时接收系统上层软件发送的图形命令完成各种飞行参数画面的绘制。论文首先阐述了视频处理模块中视频采集、视频缩放、帧速率提升以及视频输出模块在FPGA上的设计和实现。然后讨论了图形生成模块中各个基本图形的快速生成及反走样算法,对直线反走样算法提出了改进方法,提高了小角度直线的显示效果;同时提出了增加图形缓存模块的方法,大大加快了图形的存储速度。最后本文分析了系统外部存储管理

 

 

OFDMA下行同步和信道估计研究与FPGA实现

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高速移动场景中的时频同步和信道估计技术并进行了FPGA实现。在此基础上,深入研究了基于OFDMA技术的下一代通信系统,具有很强的现实意义。本文的主要内容概括如下:详细分析了OFDMA多址原理、子载波分配方式以及由此带来的频率分集增益和相对于传统的OFDM方式增加的灵活性。分析了典型OFDMA系统IEEE802.16eTDD帧结构,上、下行链路中不同的子信道划分方式对移动性的支持。给出了子信道中子载波分配的具体方法。仿真了基于训练序列相关性的粗同步和精同步算法检测性能,验证

 

 

基于FPGA的机载SAR/ISAR实时成像的技术研究

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目标SAR/ISAR混合成像的方法,以及算法的FPGA实时处理。机载雷达对舰船成像时雷达和目标都在运动,因此用SARISAR都难以达到理想的效果。由于载机的运动引起了比较明显的包络走动和弯曲,使相邻包络的相关性很差,从而使包络对齐十分困难,必须用SAR的方法进行距离徙动校正,把回波包络“扳直”。对回波信号进行解线频调(dechirp)处理后,再作逆傅立叶变换,提取单个目标就可以作ISAR处理的包络对齐和自聚焦了。本文采用FPGA作为主处理器实时处理SAR/ISAR的混合成

 

 

AM-OLED真彩色显示系统的FPGA实现

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频率,最终选用DVI数字解码芯片,给出了基于640×480RGB真彩色AM-OLED屏显示的系统性方案,并分析整个系统的工作流程以及部分主要模块的作用。在本文的最后,利用基于Altera公司的FPGA技术,以Verilog HDL为描述语言,设计了AM-OLED真彩色显示的驱动控制电路,并在DE2-115开发板上对系统的部分模块进行了仿真。Modelsim仿真结果表明,该方案能够达到预定目标,实现640×480RGB彩色AM-OLED屏的256级灰度显示。

 

 

基于FPGA的全帧转移CCD图像采集系统的设计与实现

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基于课题要求和CCD的成像原理,设计了一种基于FPGA的全帧转移CCD图像采集系统。本文的研究工作主要体现在以下几个方面:(1CCD驱动电路和CCD信号处理硬件电路的设计。本课题采用了柯达公司的KAF-0261型全帧转移型CCD进行图像采集,搭建了CCD驱动硬件电路,FPGA产生的控制信号时序经过大功率MOS管进行电平转换后生成驱动CCD所需的信号。此外,对于KAF-0261芯片所需的+15V-10V的电压,采用了Linear公司生产的低压线性稳压器LT3472来获得。

 

 

基于FPGAAD转换控制器设计

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采用FPGA器件EP1C12实现了对A/D转换芯片AD7822的实时采样控制,并将采集的数据暂存到SRAM中以备后续处理。整个设计在QuartusⅡ环境下,采用Verilog HDL语言描述,给出了硬件电路连接、硬件内部逻辑设计以及测试波形,可用于模拟信号的高速实时采集。

 

 

实时车辆排队长度图像检测系统及FPGA硬件实现

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法适用于实际复杂路口环境的缺陷,设计了一种基于FPGA的实时车辆排队长度图像检测系统.通过形态学边缘处理检测车辆的存在,对检测出的车队轮廓进行水平投影并采用一种基于信息量的车辆度量方法从投影结果中提取了排队的队尾,同时在确定排队长度时通过对算法参数的自适应调整有效消除图像逆透视效果的干扰;整个图像处理过程完全利用FPGA硬件逻辑实现,采用五级并行流水设计保证图像采集、高斯滤波、Sobel边缘检测、阈值分割和形态学腐蚀处理同步执行且同时完成,实现了对分辨率为720×576的图

 

 

基于FPGA的窦房结电图信号处理与分析技术的研究

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对常规心电图自动分析技术的重要补充和拓展。基于FPGA的窦房结电图自动分析技术更是自动分析技术的发展方向。本文针对将窦房结电图自动分析技术移至前端进行了探索性研究,主要研究工作是在FPGA上实现窦房结电图信号处理与分析及上位机软件研制。本文研究的重点是窦房结电图信号预处理及特征波形自动识别算法在前端FPGA上的实现。预处理部分针对算法实现的环境及噪声特点,选用和设计了16FIR带通滤波器,并将它运用于实际系统分析,取得了较好的预处理效果。特征波形识别部分提出了一种简单有效

 

 

 

应用于语音信号处理的FPGA并行访问设计

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为了实现实时语音处理,利用FPGA并行访问的特性,采用低地址物理存储空间由FPGA可配置逻辑模中的存储资源实现;高地址的物理存储空间由存储阵列实现,设计了动态置换算法来控制逻辑地址空间到物理空间的映射,将频繁访问且冲突概率高的数据块映射到低地址的物理存储空间上。实验数据表明,采用并行访问控制的动态置换算法能够实现稳定的访存性能。

 

 

FPGA在多路数据采集系统中的应用研究

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数据采集系统在测量、控制、信息处理等多学科领域有着广泛的应用,传统的以单片机为核心的多路数据采集系统原理简单、技术成熟、选型方便,但也存在的外围芯片多、电路复杂、不易升级与改进等缺点;鉴于此,提出了一种以FPGA为逻辑控制核心的多路数据采集系统设计方案,重点介绍了关键器件的选择、FPGA功能模块设计、FPGA外围电路设计;并结合部队实际需求,成功地将这一方案应用到武器装备测试系统的研制过程中,体现了较高的军事及经济价值。

 

 

基于FPGA的步进电机控制器设计

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为了达到控制步进电机正反转和变速运动的目的,采用了一种可编程FPGA技术的方法,通过Altera公司的软件Quartus9.0及其DE0开发板进行了设计和仿真分析,以及连接以东芝公司的TB6560AHQ步进电机驱动芯片为核心的驱动器和57BYG223混合式步进电机进行了实验验证,预先设定了等4个档位的速度,实现了步进电机的运动控制和相应速度的显示功能。最后实验结果表明,该设计控制方便,便于调试。

 

 

基于IEEE802.11aOFDM系统信道估计算法研究与FPGA实现

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两者的输出结果一致,由此可证明信道估计与均衡在FPGA上得到了正确的实现。由于信道均衡仿真结果并不能直观的反映均衡结果的正确性,所以,本文在此基础上又进行了解映射部分的硬件设计。通过对解映射输出数据的比较,可以发现硬件仿真结果与Matlab仿真结果以及功能仿真结果一致,由此验证了解映射模块硬件实现的正确性和信道估计与均衡输出结果的正确性。将信道估计与均衡模块以及解映射模块进行联合仿真测试,结果证明FPGA上的在线测试结果与功能仿真结果一致。仿真结果说明信道估计与均衡以及解映

 

 

基于LabVIEW FPGA虚拟数字成形滤波器VI设计

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对数字基带成型滤波的应用、原理及实现进行了研究。分析了在LabVIEW软件开发环境下进行滤波器实现的优势,介绍了数字成型滤波技术的应用实现和设计过程中所需的MATLAB常用分析工具,给出了整体设计思路和原理、FPGA设计流程和LabVIEW软件开发技巧,讨论了基于LabVIEW环境下FPGA模块数字成形滤波器的实现方案,该方案已成功应用于水下靶标中。

 

 

基于FPGA的高速实时数据采集处理系统

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介绍了具有多路数据采集、长线传输及实时监测处理等特点的存储测试系统。系统数据采集部分采用FPGA作为主控单元,结合外围控制电路将采集的模拟信号通过RS-485总线长线传输至高速读数装置,再由高速读数装置将数据通过USB控制器传送至PC,并对其进行实时监测和分析处理。采用该方法设计的采集系统能有效完成多路数据采集及远距离传输的任务,且成功地用于某装置的输出信号检测。

 

 

作者: 来源:网络
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