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HighSpeedLogic项目案例:基于FPGA的逼近香浓极限的LDPC编译码

时间:2016-3-10 18:58:44 点击:

  核心提示:基于FPGA的逼近香浓极限的LDPC编译码...

1.项目背景

       本项目来源于XXX公司的《深空信道高速数据传输系统》。

       项目启动时间:2011年6月;

       项目结束时间:2012年1月;

2.项目技术指标

       数据传输码率:128Mbits;

       误码率:SNR=3db,误码率达到10-5以内;

       硬件平台:Xilinx公司的Virtex5某型号FPGA芯片;

       开发软件:ISE12.2;

3.项目总体方案

       码长:8064;

       码率:0.75;

       译码方案:改进型TDMP译码算法;

4.项目性能测试

模拟不同的噪声干扰,然后通过ChipScope进行数据采集,每次采集16384个进行保存,连续采集100次,将数据导入matlab。性能曲线如下所示:

 

5.总结

目前该LDPC模块以及具有通用化功能,具有较好的性能和通用性。

6.参考文献

[01] Gallager R G. Low-density parity-check codes[J]. IRE Transactions onInformation Theory, 1962, 8(1): 21-28.

[02] Berrou C. The ten-year-old turbo codes are entering into service[J]. IEEE Communications magazine, 2003, 41(8): 110-116.

[03] Yeo E, Pakzad P, Nikolic B, et al. High throughput low-density parity-check decoder architectures[C]//Global Telecommunications Conference, 2001. GLOBECOM'01. IEEE. IEEE, 2001, 5: 3019-3024.

[04] Darabiha A, Carusone A C, Kschischang F R. Multi-Gbit/sec low density parity check decoders with reduced interconnect complexity[C]//Circuits and Systems, 2005. ISCAS 2005. IEEE International Symposium on. IEEE, 2005: 5194-5197.

[05] Rovatti R, Mazzini G, Setti G. Shannon capacities of chaos-based and conventional asynchronous DS-CDMA systems over AWGN channels[J]. Electronics Letters, 2002, 38(10): 478-480.

作者:HighSpeedLogic 来源:HighSpeedLogic
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